快速指令集计算机

快速指令集计算机(RISC:Reduced Instruction Set Computing RISC)是一种执行较少类型计算机指令的微处理器，起源于80年代的MIPS主机（即RISC机），RISC机中采用的微处理器统称RISC处理器。这样一来，它能够以更快的速度执行操作（每秒执行更多百万条指令，即MIPS）。因为计算机执行每个指令类型都需要额外的晶体管和电路元件，计算机指令集越大就会使微处理器更复杂，执行操作也会更慢。纽约约克镇IBM研究中心的John Cocke证明，计算机中约20%的指令承担了80%的工作，于1974年，他提出RISC的概念。许多当前的微芯片都使用RISC概念。

概述快速指令集计算机：(RISC:Reduced Instruction Set Computing)一种指令长度较短的计算机，其运行速度比CISC要快。RISC和CISC是 CPU 从指令集的特点上可以分为两类 :CISC 和 RISC 。 RISC 是英文 Reduced Instruction Set Computing 的缩写 , 就是 " 精简指令运算集 ” ， CISC就是 " 复杂指令运算集 " 。RISC 的指令系统相对简单，它只要求硬件执行很有限且最常用的那部分指令，大部分复杂的操作则使用成熟的编译技术，由简单指令合成。目前在中高档服务器中普遍采用这一指令系统的 CPU ，特别是高档服务器全都采用 RISC指令系统的 CPU 。在中高档服务器中采用 RISC 指令的 CPU 主要有 Compaq （康柏，即新惠普）公司的 Alpha 、 HP 公司的 PA-RISC 、 IBM 公司的 Power PC 、 MIPS 公司的 MIPS 和 SUN 公司的 Sparc 。

RISC是相对于复杂指令集计算机(CISC)而言的。所谓复杂指令集计算机是依靠增加机器的硬件结构来满足对计算机日益增加的性能要求。计算机结构的发展一直是被复杂性越来越高的处理机垄断着，为了减少计算机操作与高级语言的差别，为了改善机器的运行特性，机器指令越来越多，指令系统也越来越复杂.特别是早期的较高速度的CPU和较慢速度的存储器间的矛盾，为了尽量减少存取数据的次数，提高机器的速度，大大发展了复杂指令集，但随着半导体工艺技术的发展，存储器的速度不断提高，特别是高速缓冲的使用，使计算机体系结构发生了根本性的变化，硬件工艺技术提高的同时，软件方面也发生了同等重要的进展，出现了优化编译程序，使程序的执行时间尽可能减少!并使机器语言所占的内存减至最小，在具有先进的存储器技术和先进的编译程序的条件下，CISC体系结构已不再适用了，因而诞生了RISC体系结构，RISC技术的基本出发点就是通过精减机器指令系统来减少硬件设计的复杂程度，提高指令执行速度，在RISC中，计算机实际上每一个机器周期里都执行指令，无论简单或复杂的操作，均由简单指令的程序块完成，具有较强的仿真能力。

在RISC机器中，要求在`单机器周期’时间内执行所有的指令，而系统最根本的吞吐率限制是由程序运行中访存时间比例所决定的，因此，只要CPU执行指令的时间与取指时间相同，即可获得最大的系统吞吐率。(对于一个机器周期执行一条指令而言)。RISC机器中，采用迁件控例以实现认速哪一指令译码，并采用较少的指令和简单寻址模式，通过固定均指令格式来优化指分译码和控制逻辑。另外，RISC设计是以复杂的设计优化来求取简单的硬件芯片环境.编译优化可以改善HLL程序的运行效率。

R1SC设计消除了微码的例行程序，把机器代级控制交给软件处理.即用较快的RAM代替处理器中的微码ROM作为指令的缓存(Cache)，计算机的控赶驻存在指令Cache，从而使得计算机系统和编译器产生的指令流使高级语言的需求和硬件性能密切配合。

计算机的性能可以用完成一特定任务所需的时间来衡量，这个时间等于CXTXl。

C=完成每条指令所需的周期数

T=每个周期的时间

I=每个任务的指令数

RISC技术就是努力使C和T减至最小，C和T的减小可能导致I的增匆，但优化编译技术和其他技术的采用可以弥补由于I的增加对机器性能的影响.RISC技术之所由很快由一种新见解发展成为前景广娜的计算机市场，主要有如下几方面的原因:一是RISC结构适应只新月异的VLSI技术发展；二是RISC简化了处理器结构，实现和调试较容易，因而设计代价低，开发周期短；三是简化了结构，处理器占据了较小的芯片面积，从而可在同一芯片上集成进较大的寄存器文件，翻译后备缓冲器(TLB)、协处理器和快速乘膝器等，使得处理器获得更高的性能；四是RISC对HLL程序的支持优于以往的复杂指令系旅计算机，可以使用户(程序员)很容易使用统一的指令集，很容易估算代码优化所起的作用，使程序员对硬件的正确性有了更多的信任感。1

特点RISC的特点是指令及其格式精少，操作和控制简捷。具体有下列几个方面。

精简指令集RISC结构采用精简的，长短划一的指令集，使大多数的操作获得了尽可能高的效率。某些在传统结构中要用多周期指令实现的操作，在RISC结构中，通过机器语言编程，就代之以多条单周期指令了。精简的指令集大大改善了处理器的性能，并推动了RISC的设计。对于到底精简到什么程度的问题，没有一定的回答。将现有RISC系统与CISC系统作一对比，便可见大概。通常，对RISC而言：

指令数少，不超过128条。

寻址方式少，不超过4种。

指令格式少，不超过4种。

处理关于扩充指令集的建议是非常慎重的，要经过认真的权衡，验证，在看它们是否真正提高计算机的性能。例如，MIPS采用了一条规则：增加一条指令必须使性能在一定的应用范围内得到1%的增益，否则这条指令将被拒绝。

指令长度相等如果每一条指令要执行的任务既简单又明了，则执行每一条指令所的时间可以被压缩周期数也可减少。RISC的设计目标是实现一个机器周期执行一条指令，使得系统操作更加有效。接近这个目标的技术包括指令流水线及特定的装/存结构等。典型的指令可包括取指、译码、执行和存装果等阶段。单周期指可通过让所有指令为标准长短来实现。标准指令长短应与计算机系统的基本字长相等，通常与系统中数据线数相等。

在任何取指周期，完整的单个指令要传给CPU。例如，如果基字长是32位，且系统总线的数据部分是32线，则标准指令长度是32位。要让所有指令的执行时间一致较困难。有些指令，包含简单的在CPU寄存器上的逻辑操作(清寄存器等)，则可容易地在一个CPU时钟周期内执行；其它指令可能包含内存存取(对内存的读写、取数等)或多周期操作(乘、除等)，可能无法在单周期内执行。这给设计者提出了这样的要求；让大多数经常使用的指令得以在一个单周期内执行。

指令流水线减少执行一条指令所需周期数的方法是重叠执行多条指令。指令流水线采用这样的工作方式：将每条指令的执行分为几个离散部分，然后同时执行多条指令。任何指令的取指和执行阶段占据相同时间，理想的是一个单周期。这可说是RISC最重要的一条设计原则。所有从内存到CPU执行的指令，都遵循一种恒定的流的形式。每条指令都以同样的步调执行，无等待的指令。CPU始终是忙的。达到流水线操作的必要条件是：

标准的，固定长短的指令，它与计算机字长和数据线的字长相等。

所有指令的标准执行时间，最好在一个单CPU周期内。

例SPARC芯片等采用了取指、译码、执行和写入结果四级流水线结构，以最大限度来提高处理器性能。在每一个时钟周期的头上，都可以开始执行一条新的指令，这就保证了每个机器周期从存贮器平均取出一条新的指令，从而，总体看，大多数指令能在单周期内实现。指令流水线技术可以比作一条装配线—指令象是被加工的产品一样，从一道工序流到下一道工序，一直到它执行完为止。

因此，指令流水线利用一个等于其流水线深度的因子，来减少指令周期数是可能的，但这样的话，要求流水线始终充满有用指令且没有任何东西阻碍指令通过流水线，这样的需求给结构增加了一定的负担。例如，对于ALU等资源的竞争，阻止了流水线中指令的流动。长短不一的执行时间所引起的不良后果更是显而易见，这也是为什么RISC要定义一个有前面所述特点的指令集的原因。

装入和存数结构执行与内存有关的操作指令，不是要求增加每个周期的时间，就是要求增加指令的周期数，二者必取其一。因为这些指令要计算操作数的地址，将所需的操作数从内存中读出，计算得出结果，再把结果送回内存，所以它们执行的时间就长得多。为了消除这种指令的负作用，RISC采用了这样的装入和存数结构：只有装入(Load)和存数(Store)指令才去访间内存，所有其它操作只访问保存在处理器寄存器中的操作数。其优点在于：

减少访问内存的次数，降低了对内存带宽的要求。

将所有的操作限制于只针对寄存器，帮助了指令集的简化。

取消内存操作可使编释器优化寄存的分配更容易—这种特性减少对内存的存取，同时也减少了每一任务的指令数。

所有这些都有助于RISC实现的每个周期执行一条指令的目标。尽管如此，装入和存数指令仍阻碍着IRSC设计目标的实现。用优化编译技术处理装入指令和分支指令的延迟，有助问题的解决。优化编译技术虽不是专门面向RISC结构的，但优化编译器依赖于RISC结构完成其出色的任务，RISC结构又依赖于优化编译器得到它们更完善的性能。编释器要能分析数据和控制流，并在此基础上调整指令的执行顺序，巧妙安排寄存器的用法。前一种作用可减少CPU的空闲时间，后一种作用可以提高寄存器中所保存的数据的可再用率，减少访存次数，缩短数据通路的长度。

拥有较大寄存器组为了便于实现多数指令在寄存器之间的操作，即所谓的寄存器到寄存器操作，必须有足够量的CPU通用寄存器。足量的寄存器使得在随后操作中需作为操作用的中间结果暂存在CPU寄存器中，因而就减少了对内存的装入和存数，加快了运行速度。工业化RISC系统中至少采用32个通用CPU寄存器。

采用硬连线控制由于微程序设计给设计者提供的灵活性，许多CISC系统是微程序控制的。不同的指令通常具有不同长度的微程序，这意味着每条指令执行的周期数不一样，这与所有指令一致的、流线的处理原则相矛盾。但这可由硬连线控制来解决，而且速度会更快。因此RISC应该是硬连接线控制的。当每条指令与一单条微指令有一对一相相符合的关系时可有例外，也就是每个微程序由一单个控制字组成。这种设计可与用硬连线控制一样快，一样高效，并使设计者得益于微程序设计的优越性。采用硬连线控制，可使RISC系统控制器简单。设计的简单又使机器的布局更加合理，使得设计者可以集中精力去优化那些剩下的，为数不多的，但又很关键的处理器特性。简化的结构使芯片上面积资源紧张的状态得以缓解，一些对性能至关重要的结构，象大的寄存器元件，转换查找缓存(TLB)S协处理器和乘除单元都可以装在同一块芯片上。这些附加的资源又使处理器增加了很大的性能优势。事实上，RISC并非一定严格地完全具备上述特点，有些称作RISC型的系统甚至违背了上述某方面。上述特点应被当作一种指导原则来解释RISC的性质。放宽点讲，满足大部分这些特点的系统就能被看作RISC。2

本词条内容贡献者为:

李岳阳 - 副教授 - 江南大学